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计算机体系结构
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预取只有在处理器能继续执行其它指令的同时进行才有意义。

题库:计算机体系结构 类型:判断题 时间:2017-06-23 23:39:59 免费下载:《计算机体系结构》Word试卷

预取只有在处理器能继续执行其它指令的同时进行才有意义。

预取只有在处理器能继续执行其它指令的同时进行才有意义。

本题关键词:有权同意,有效同意,执行器,行政处罚执行,行政意义,有效行为,行为有效性,进行性意识障碍,监理指令,损其有余;

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硬件预取通常需要非阻塞cache的支持。

Cache命中时间往往会直接影响到处理器的时钟频率。

采用容量小、结构简单的Cache会减小cache的命中时间。

写操作流水化会减小cache的命中时间。

素数模法是避免存储体冲突的一种方法。

TLB是页表转换查找缓冲器。

TLB中的内容是页表部分内容的一个副本。

在共享存储器上支持消息传递比在消息传递的硬件上支持共享存储器困难得多。

流水线吞吐率是指单位时间内流水线所完成的任务数。

流水线可能达到其最大吞吐率。

流水线加速比是指流水线最大润如率和实际吞吐率之比。

Cache失效中必定包含强制性失效。

Cache失效中必定包含容量失效。

Cache失效中必定包含冲突失效。

组相联或直接映象Cache中才可能存在冲突失效。

支持“失效下命中”的cache是非阻塞Cache。

虚存系统所用的cache称为虚拟Cache。

有统一的时钟协调各个设备操作的总线是同步总线。

硬件在预取时,如果出现虚地址故障或违反保护权限,就会发生异常。

多处理机系统由多个不同类型的处理机组成。

相关关键词
有权同意有效同意执行器行政处罚执行
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